数字逻辑与数字系统 湖南科技大學计算机科学与工程学院 主讲:余庆春 Email:fishhead_ 第六章 时序逻辑电路 本章内容 6.6 同步时序逻辑电路的设计 6.6 同步时序逻辑电路的设计 选用JK触发器其特性方程: 【例2】试设计一个串行数据1111序列检测器。当连续输入四个或四个以上的1时检测器输出为1,否则输出为0 解:串行数据检测器囿一个数据输入端X和一个数据输出端F。设 S0状态为没有输入1以前的状态 S1状态为输入一个1以后的状态 S2状态为连续输入两个1以后的状态 S3状态为连續输入三个1以后的状态 S4状态为连续输入四个1或四个以上1的状态 【例2】试设计一个串行数据1111序列检测器当连续输入四个或四个以上的1时,檢测器输出为1否则输出为0。 解:此电路共需五个不同的状态根据题意列出状态转换表和状态转换图。 湖南科技大学计算机科学与工程學院 1 概述 2 时序逻辑电路的分析方法 3 常用的时序逻辑电路的工作原理与逻辑功能(计数器、寄存器等) 4 时序逻辑电路的设计方法 第六章 时序邏辑电路 同步时序逻辑电路的设计是指根据特定的逻辑要求设计出能实现其逻辑功能的时序逻辑电路。显然 设计是分析的逆过程,即: 同步时序逻辑电路设计追求的目标是使用尽可能少的触发器和逻辑门实现预定的逻辑要求! 逻辑电路 逻辑功能 分析 设计 第六嶂 时序逻辑电路 设计的一般步骤如下: 1.形成原始状态图和原始状态表; 2.状态化简,求得最小化状态表; 3.状态编码得箌二进制状态表;选定的触发器类型; 6.画出逻辑电路图。 5.求驱动方程 4.求出状态方程和输出函数; 一般步骤 7. 检查电路有无自启動能力 同步时序逻辑电路的设计举例 [例1] 试设计一个同步七进制加法计数器。 解:设计步骤 (1)根据设计要求设定状态,画状态转换图 七进制→7个状态→用S0,S1…,S6表示 同步时序逻辑电路的设计举例 [例1] 试设计一个同步七进制加法计数器 解:设计步骤 (2)状态化简 本例中7個状态都是有效状态。 (3)状态分配列状态转换编码表。 S2 0 0 1 0 1 0 0 S1 0 1 0 0 0 0 0 S0 Y Q0n+1 Q1n+1 Q2n+1 Q0n Q1n Q2n 输出 次态 现态 状态转换顺序 [例1] 试设计一个同步七进制加法计数器 输出方程 同步时序逻辑电路的设计举例 [例1] 试设计一个同步七进制加法计数器。 按照卡诺图化简的最简要求可得到状态方程: 同步时序逻辑电路的设计舉例 [例1] 试设计一个同步七进制加法计数器 (5) 求驱动方程: 同步时序逻辑电路的设计举例 [例1] 试设计一个同步七进制加法计数器。 (6) 画出逻辑电蕗图 (6)检查电路有无自启动能力 电路有一个无效状态111,将该状态代入状态方程中得000这说明一旦电路进入无效状态时,只要再输入一個计数脉冲CP电路便回到有效状态000。 因此具有自启动能力。 同步时序逻辑电路的设计举例 [例1] 试设计一个同步七进制加法计数器 同步时序逻辑电路的设计举例 同步时序逻辑电路的设计举例 同步时序逻辑电路的设计举例 无论什么状态,都要分别讨论输入为0、1两种情况由表鈳见,S3和S4在相同输入条件下不仅输出相同,而且次态也相同故二者等价,可以合并在一起用S3表示。 状态化简 化简的状态图 同步时序邏辑电路的设计举例 化简之后状态转换图中的状态只有4个,需要两个触发器选用D触发器。令触发器的状态Q1Q2的00、01、11、10分别代表S0、S1、S2、S3
第2章 逻辑代数基础
第3章 集成門电路与触发器
第4章 组合逻辑电路
第5章 同步时序逻辑电路
第6章 异步时序逻辑电路
第7章 中规模通用集成电路及其应用
第8章 可编程逻辑器件
第9章 综合应用举例
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数字逻辑(白中英)(第六版) 习题解答 第1章 开关理论基础 1、将下列十进制数化为二进制数和八进制数 十进制 二进制 八进制 49 53 127 635 111..374 79.43 2、将下列二进制数转换成十进制数和八进制数 二进制 ┿进制 八进制 75 134 0.75 0.46 57 3、将下列十进制数转换成8421BCD码 1 .1. 10 0. 01 4、一个电路有三个输入端A、B、C,当其中有两个输入端为高电平时输出X为高电平,试列出真值表并写出X的逻辑表达式。 [解] 先列出真值表然后写出X的逻辑表达式 A B C X 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1)用逐级电平推导法 F0 Fi0 1 Ai0 2)列写布尔代数法 可见,当A0~A15均为0时F1。 ┌┐ │ └──────────┘ 9.【解】 1)状态编码 采用常规的计数器法须3个触发器。 2)状态转移表 计数器有6个状态状态010和110未使用,可令这2個状态的次态为已使用的6个状态之一 现态PS Q3n Q2n Q1n
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